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Si4770/77-A20
Table 4. Digital Zero-IF I/Q Interface Characteristics (Si4777 Only) 1
(T AMB = –40 to 85 °C, V A = 4.5 to 5.5 V, V D = 2.7 to 3.6 V, V IO1 = 1.7 to 3.6 V, V IO2 = 1.2 to 3.6 V)
Parameter
Symbol
Test
Min
Typ
Max
Unit
Condition
IQCLK Output Cycle Time
IQCLK Output Pulse Width High
IQCLK Output Pulse Width Low
IQFS Output Delay
IQFS Output Setup to IQCLK
Rise 3
IOUT Output Delay
QOUT Output Delay
IOUT Output Setup to IQCLK rise 3
QOUT Output Setup to IQCLK
Rise 3
t CYC:IQCLK
t HI:IQCLK
t LO:IQCLK
t PD:IQFS
t SU:IQFS
t PD:IOUT
t PD:QOUT
t SU:IOUT
t SU:QOUT
0.8 x per
0.22 x per
0.41 x per
0
(0.5 x per) – 18
0
0
(0.5 x per) – 18
(0.5 x per) – 18
per 2
—
—
—
—
—
—
—
—
1.2 x per
0.59 x per
0.78 x per
(0.5 x per) + 18
—
(0.5 x per) + 18
(0.5 x per) + 18
—
—
ns
ns
ns
ns
ns
ns
ns
ns
ns
Notes:
1. Guaranteed by characterization.
2. per is the IQCLK I/Q bit clock period. Refer to Table 15 on page 35 for IQCLK bit clock frequencies.
3. Minimum time the Si4770/77-A20 will produce between valid output and the next rising edge of IQCLK
t CYC:IQCLK Max
t CYC:IQCLK Min
IQCLK out
IQFS out
IOUT out
t HI:IQCLK MIN
t HI:IQCLK MAX
t PD:IQFS MAX
t PD:IQFS MIN
t PD:IOUT MAX
t PD:IOUT MIN
t PD:QOUT MAX
t LO:IQCLK MAX
t LO:IQCLK MIN
t SU:IQFS
t SU:IOUT
t SU:QOUT
t PD:QOUT MIN
QOUT out
Figure 2. Digital Zero-IF I/Q
8
Rev. 0.9
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